仁爱_EDA技术与应用_第二章.docx
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1、TJRA - i_ 尸 cl i rl Itai I2.1 Verilog HDL简介HDL: Hardware Description LanguageO数字系统设计越来越复杂 规模越来越大硬件描述语言HDL是一种用形式化方法描述数字电路和系统的 语言,可以描述硬件电路的功能,信号连接关系和定时关系。HDL应用越来越广泛使用HDL的优点 电路的逻辑功能容易理解; 便于计算机对逻辑进行分析处理; 把逻辑设计与具体电路的实现分成两个独立的阶段来 操作; 逻辑设计与实现的工艺无关; 逻辑设计的资源积累可以重复利用;可以由多人共同更好更快地设计非常复杂的逻辑电路 (几十万门以上的逻辑系统)。9Top
2、_Down设计思想Verilog HDL的发展Ver iI os HDLVer i log I EEE1 364-2001公开发表标准公开发表CADENCE 公司标准公开发表Ver iI os-XL模拟和数字都适用的Ver i I 目标准公开发表J9991( 989 ):_19805 1990 购买V er i I 版权诞生Ver i lolEEE1364-19951990有关 Vb IoeHDL 的全部权利都移交给OVI (Open Veri log-Verilog-HDL 的应用ASIC和FPGA设计师可用它来编写可综合的代 码。描全系统的结构,做高层次的仿真。验证工程师编写各种层次的测试
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