实验二组合逻辑电路的设计与测试.ppt
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1、实验二、组合逻辑电路的设计及测试,实验内容: 1、设计用与非门及用 异或门、与门组成的半加器(74LS00、74LS86、74LS08) 2、设计一个一位全加器,要求用异或门、与门及或门组成(74LS86、74LS08、74LS32) 3、设计一位全加器,要求用与或非门实现(74LS51),实验预习要求,1、根据实验设计任务要求,建立输入、输出变量,列出真值表。 2、按实际选用逻辑门的类型,用逻辑代数和卡诺图化简两种方法求出简化的逻辑表达式 3、根据修改后的表达式,画出用标准器件构成的逻辑电路图,并标注管脚号。 4、写出完整设计过程;熟练使用仿真软件,并进行仿真(没学过仿真软件的专业,可以不仿
2、真) 思考题:5、如何用最简单的方法验证与或非门的逻辑功能是否完好? 思考题: 6、与或非门中,当某一组与端不用时,应如何处理?,一、实验目的,掌握组合逻辑电路的设计与测试方法,二、组合逻辑电路的设计流程,4、设计一个对两个两位无符号的二进制数进行比较的电路,根据第一个数是否大于、等于、小于第二个数,使相应的三个输出端中的一个输出为“1”,要求用与门、与非门及或非门实现(74LS08、74LS00、74LS20、74LS02),设计原理: 、半加器:两个一位二进制相加,叫做半加,实现半加操作的电路叫半加器 。 、全加器:全加器是带进位的加法运算,即两个同位的加数和来自低位的进位三者相加,这种加
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